
Verilog中对串、并、转换以及并串转换的实现。
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简介:
在 Quartus 环境下进行工程开发,我独立编写了 SIPO 和 PIso 两个模块,利用 Verilog 语言分别完成了串到并的转换以及并到串的转换功能,这些模块的设计力求简洁明了,易于理解。
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简介:
在 Quartus 环境下进行工程开发,我独立编写了 SIPO 和 PIso 两个模块,利用 Verilog 语言分别完成了串到并的转换以及并到串的转换功能,这些模块的设计力求简洁明了,易于理解。


