基于NIOS II的FPGA电子钟设计
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简介：
本项目基于NIOS II软核处理器，在FPGA平台上设计实现了一款功能丰富的电子钟，集成了时钟、日历及闹钟等功能。
使用Verilog语言编写数码管的驱动程序，并利用SOPC技术进行硬件设计。在软件部分采用NiOS II系统实现相关功能。
1. 通过Qsys生成的定时器timer_1ms来完成计时任务。
2. 利用8个独立的数码管显示当前时间。
3. 设有三个按钮，分别用于调整时间和闹钟设定：按键一负责切换模式（包括正常时间显示、小时调节、分钟调节和秒数调整等四种状态）；按键二在非默认模式下增加指定的时间数值，但不会超出上限值；按键三则是在相同条件下减少该数字，并确保不低于零。
4. 引入闪烁标志功能，用于指示当前正在被修改的具体时间位。
5. 当任一按钮被按下时，相应的LED灯会被点亮作为反馈提示。
6. 通过蜂鸣器实现闹钟提醒功能，在达到预设的闹铃时刻会触发流水灯效果进行额外的通知。
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