
数字钟的设计(基于数字逻辑与数字系统课程设想)。
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简介:
基本要求1:该系统具备精确的时、分、秒计时功能,能够通过八个数字显示屏分别呈现24小时、60分钟、60秒钟以及0.99秒的计数数据。2:系统能够借助实验系统上的按键,实现“校时”、“校分”操作。具体而言:(1) 按下“SA”键时,计时器将迅速递增,并以24小时循环方式运行,当计数达到23小时时会回零;(2) 按下“SB”键时,计数器将迅速递增,并以60分钟循环方式运行,当计数达到59分钟时会回零,且不会向“时”位进位;(3) 无论按下“SA”、“SB”或“SC”键,都应避免出现数字跳变(这些按键可能存在抖动现象,因此需要进行抖动消除处理)。3:系统还具备利用扬声器进行整点报时的功能。具体实现如下:(1) 当计时达到59分50秒时开始发出报时提示,在59分50秒、52秒、54秒、56秒和58秒之间依次鸣叫,鸣叫频率可设置为512Hz;(2) 当计时到达59分60秒时发出最后一声整点报时提示,整点报时的频率可设置为1024Hz。4:电路设计应采用层次化方法进行实施,并使用Verilog语言编写各个功能模块。 5:完成电路设计后,需要利用实验系统进行下载和验证以确保其正常运行。
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