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dma_axi_master.zip

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简介:
dma_axi_master.zip包含用于设计直接内存访问(DMA)控制器的AXI总线主协议接口的相关文件和源代码。适用于FPGA开发与嵌入式系统优化。 以下是文件列表: - dma_axi64.v - vdma_axi64_dual_core.v - vdma_axi64_apb_mux.v - vdma_axi64_reg.v - vdma_axi64_reg_core0.v - vprgen_scatter8_1.v - vdma_axi64_core0_top.v - vdma_axi64_core0.v - vdma_axi64_core0_wdt.v - vdma_axi64_core0_arbiter.v - vdma_axi64_core0_ctrl.v - vdma_axi64_core0_axim_wr.v - vdma_axi64_core0_axim_cmd.v - vdma_axi64_core0_axim_timeout.v - vdma_axi64_core0_axim_wdata.v - vprgen_joint_stall.v - vprgen_fifo.v - vprgen_stall.v - vdma_axi64_core0_axim_resp.v - vdma_axi64_core0_axim_rd.v - vdma_axi64_core0_axim_rdata.v - vdma_axi64_core0_channels.v - vdma_axi64_core0_channels_apb_mux.v - vdma_axi64_core0_channels_mux.v - vprgen_or8.v - vprgen_mux8.v - vprgen_demux8.v - vdma_axi64_core0_ch.v - vdma_axi64_core0_ch_reg.v - vdma_axi64_core0_ch_reg_size.v - vprgen_rawstat.v - vdma_axi64_core0_ch_offsets.v - vdma_axi64_core0_ch_remain.v - vdma_axi64_core0_ch_outs.v - vdma_axi64_core0_ch_calc.v - vdma_axi64_core0_ch_calc_addr.v - vdma_axi64_core0_ch_calc_size.v - vprgen_min3.v - vprgen_min2.v - vdma_axi64_core0_ch_calc_joint.v - vdma_axi64_core0_ch_periph_mux.v - vdma_axi64_core0_ch_fifo_ctrl.v - vdma_axi64_core0_ch_wr_slicer.v - vprgen_swap_64.v - vprgen_swap_32.v - vdma_axi64_core0_ch_rd_slicer.v - vdma_axi64_core0_ch_fifo_ptr.v - vdma_axi64_core0_ch_fifo.v - vdma_axi64_core0_ch_empty.v - vprgen_delay.v

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    dma_axi_master.zip包含用于设计直接内存访问(DMA)控制器的AXI总线主协议接口的相关文件和源代码。适用于FPGA开发与嵌入式系统优化。 以下是文件列表: - dma_axi64.v - vdma_axi64_dual_core.v - vdma_axi64_apb_mux.v - vdma_axi64_reg.v - vdma_axi64_reg_core0.v - vprgen_scatter8_1.v - vdma_axi64_core0_top.v - vdma_axi64_core0.v - vdma_axi64_core0_wdt.v - vdma_axi64_core0_arbiter.v - vdma_axi64_core0_ctrl.v - vdma_axi64_core0_axim_wr.v - vdma_axi64_core0_axim_cmd.v - vdma_axi64_core0_axim_timeout.v - vdma_axi64_core0_axim_wdata.v - vprgen_joint_stall.v - vprgen_fifo.v - vprgen_stall.v - vdma_axi64_core0_axim_resp.v - vdma_axi64_core0_axim_rd.v - vdma_axi64_core0_axim_rdata.v - vdma_axi64_core0_channels.v - vdma_axi64_core0_channels_apb_mux.v - vdma_axi64_core0_channels_mux.v - vprgen_or8.v - vprgen_mux8.v - vprgen_demux8.v - vdma_axi64_core0_ch.v - vdma_axi64_core0_ch_reg.v - vdma_axi64_core0_ch_reg_size.v - vprgen_rawstat.v - vdma_axi64_core0_ch_offsets.v - vdma_axi64_core0_ch_remain.v - vdma_axi64_core0_ch_outs.v - vdma_axi64_core0_ch_calc.v - vdma_axi64_core0_ch_calc_addr.v - vdma_axi64_core0_ch_calc_size.v - vprgen_min3.v - vprgen_min2.v - vdma_axi64_core0_ch_calc_joint.v - vdma_axi64_core0_ch_periph_mux.v - vdma_axi64_core0_ch_fifo_ctrl.v - vdma_axi64_core0_ch_wr_slicer.v - vprgen_swap_64.v - vprgen_swap_32.v - vdma_axi64_core0_ch_rd_slicer.v - vdma_axi64_core0_ch_fifo_ptr.v - vdma_axi64_core0_ch_fifo.v - vdma_axi64_core0_ch_empty.v - vprgen_delay.v