
华中科技大学计算机15级计算机组成原理课程设计:利用Logisim和Verilog实现简易CPU.zip
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简介:
本项目为华中科技大学2015级计算机专业《计算机组成原理》课程设计作品,通过Logisim软件及Verilog硬件描述语言构建简易中央处理器。
华中科技大学计算机15级计算机组成原理课程设计要求分别使用logisim和Verilog实现一个简单的CPU,并将相关文件打包成.zip格式。
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