
SM3国密哈希算法硬件实现代码
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简介:
本项目提供基于国家密码标准SM3设计的高效硬件实现代码,适用于需要高安全性和性能的数据处理场景。
国密杂凑算法SM3的Verilog硬件实现包括源代码、测试文件和仿真截图。在实际65nm工艺测试中,吞吐率可达40Gbps。
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简介:
本项目提供基于国家密码标准SM3设计的高效硬件实现代码,适用于需要高安全性和性能的数据处理场景。
国密杂凑算法SM3的Verilog硬件实现包括源代码、测试文件和仿真截图。在实际65nm工艺测试中,吞吐率可达40Gbps。


