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GD32C103, 一路USBCDC和两路CANFD测试通过

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简介：
简介：GD32C103微控制器已成功验证支持一路USB CDC及两路CAN FD接口功能，适用于工业通讯与嵌入式应用。 GD32C103一路USBCDC两路CANFD测试通过。

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  • GD32C103, 一路USBCDC和两路CANFD测试通过
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    简介：GD32C103微控制器已成功验证支持一路USB CDC及两路CAN FD接口功能，适用于工业通讯与嵌入式应用。 GD32C103一路USBCDC两路CANFD测试通过。
     
  • 两路WiFi通讯
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    两路WiFi通讯是指通过两个独立的WiFi网络或通道进行数据传输的技术。这项技术能够提供更加稳定、快速的数据连接和通信服务，广泛应用于物联网、智能设备及远程协作等领域。 本资源是一个基于STM32控制器编写的程序，其功能是通过两个WIFI模块互发AT指令建立连接，并在设置好的端口上进行通信。需要注意的是，其中的AT指令可能不适用于每个WIFI模块，需要自行判断和调整。
     
  • Cadence两级放大电路版图，已通过LVS和DRC检查
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    本项目通过仿真软件对基于LM393芯片的过零检测电路进行测试与分析，验证其在信号处理中的应用效果和稳定性。 LM393过零比较电路的仿真测试
     
  • Cadence 两级放大电路版图已完成，已通过LVS和DRC检查
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  • 一阶RC电路响应实验测试
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    本实验通过分析一阶RC电路对不同输入信号的响应，探讨电阻和电容在电路中的作用及其时间常数的影响。 RC一阶电路响应测试实验是电路原理课程中的一个实验项目。该实验详细介绍了具体的实验过程。
     
  • 时序电路测试程序模板一
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    本模板提供了一套针对时序电路设计的自动化测试程序框架，旨在简化和标准化测试流程，确保高效准确地验证电路性能与稳定性。 在电子设计自动化（EDA）领域，测试程序是验证数字逻辑设计功能正确性的关键步骤之一。针对时序电路的测试程序模板主要用于检查其按照预期工作的情况。这类电路由寄存器和组合逻辑构成，并且它们的操作依赖于时间序列即钟信号。 1. **信号定义**： 在Verilog编程中，首先需要定义输入、输出及内部使用的各种信号。这些信号用于传递数据与控制信息，在测试过程中起到桥梁作用。例如，常见的有`clk`(时钟)、`rst_n`(异步复位)，以及`D`(数据输入)和`Q`(数据输出)。 2. **模块实例化**： 在测试程序中会包含被测的时序逻辑电路的实例。如“reg_D”模块在此处作为待测设备（dut）进行实例化，并且与定义好的信号相连接。 3. **初始化及复位操作**： 通常利用`initial`语句来设置初始条件，比如启动时钟和复位信号。“rst_n”被设为低电平以执行重置过程。这样可以确保所有寄存器的状态都被清零到预设值开始测试。 4. **生成时钟信号**： 通过使用`always`语句结合特定事件（如上升沿）来产生所需的时钟信号，例如：`always #(`CLK_PERIOD2) clk = ~clk;`这里创建了一个5ns周期的时钟，并且假设了宏定义存在以确定时间间隔。 5. **测试激励生成**： 为了全面覆盖各种可能的情况，在不同的输入条件下需要设计一系列的测试用例。这通常通过在初始化语句中使用事件触发和延迟来完成，例如：`D`信号会在每个时钟上升沿发生变化，以此模拟不同数据输入的状态变化情况。 6. **输出结果展示**： 利用Verilog中的系统任务如“$monitor”，可以在仿真运行过程中实时监控并打印相关信号值的变化情况。这有助于我们理解测试进展以及验证设计是否符合预期功能要求。 7. **待测设备（DUT）的响应分析**： 在提供的示例中，展示了不同时间点下输出结果的状态变化，包括复位后初始状态和随着时钟与输入改变后的反应。 该模板为结构化地测试时序逻辑电路提供了方法论支持。它涵盖了从信号定义、模块实例化直至生成时钟信号、设计激励以及监控结果的整个过程。实际应用中可根据具体的设计需求对上述模板进行适当的调整扩展。
     
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    TeeChart 8是一款经过Visual C++ 6.0及Visual Studio 2010严格测试的数据可视化控件，适用于开发高质量图表应用。 该资源可以直接注册使用，无需安装，并附带源码，已亲测可用。
     
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