
FlappyFPGA:在Nexys-3 Spartan 6 FPGA上,利用Verilog语言开发游戏Flappy Bird。
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简介:
#Flappy Bird FPGA ##我们的主要目标是重新构建 Flappy Bird 游戏,并着重于精确复制游戏中的物理操作机制。 该设计采用 Verilog 代码进行实现,随后能够被合成并下载至 Nexys3 Spartan 6 FPGA 开发板上运行。 游戏利用 Nexys 板的 VGA 输出接口进行视觉呈现,并通过按钮进行交互式控制。 ##设计 我们的 Verilog 版本 Flappy Bird 系统由四个关键模块共同驱动其核心功能。 这些模块均同步接收相同的 Start、Stop 和 Ack 信号,从而在玩家开始、失败或重新开始游戏时协调其各自的功能。 X_RAM_NOREAD 模块包含一个简化的状态机,该状态机负责管理五个管道障碍物的 x 坐标输出信息。 该模块内部包含两个数组,每个数组都存储了五个 10 位数字;一个数组记录管道左边缘的 10 位 x 坐标值,而另一个数组则保存管道右边缘的坐标值。 当状态机被重置为初始状态时,这两个数组便会被初始化为起始值。
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