
FPGA IIC通信的EEPROM仿真模型。
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简介:
在FPGA中进行IIC通信调试时,为了准确模拟总线的时序特性,需要借助一个仿真模型。该模型专门为EEPROM存储芯片AT24C64设计,其地址宽度达到13位,并能够存储高达8192个字节的数据。
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简介:
在FPGA中进行IIC通信调试时,为了准确模拟总线的时序特性,需要借助一个仿真模型。该模型专门为EEPROM存储芯片AT24C64设计,其地址宽度达到13位,并能够存储高达8192个字节的数据。


