32位IEEE-754浮点数加法器的设计

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简介：
本项目专注于设计基于IEEE-754标准的32位浮点数加法器，旨在优化浮点运算性能，适用于高性能计算领域。 32位浮点加法器设计（根据IEEE 754标准使用VHDL实现）

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