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ZYNQ7020 系列芯片中 PS 端口的两路 SPI 端口采用 EMIO 方式进行设计与实现:其中 SPI0 为主发端口、 SPI1 为从接收端口;经环通验证并通过功能测试

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简介:
ZYNQ7020, PS 端双路 SPI 采用环向互换模式 (EMIO) 实现主控端与双路 SPI 接口通信; 其中 SPI0 为主发送器 (Master), SPI1 为从接收器 (Slave); 环向互换通道 (Ring Through).

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  • STM32 JTAGI/O
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    本文介绍了一种巧妙地将STM32微控制器的JTAG调试接口重新配置为普通GPIO引脚的技术方法,适用于需要额外IO资源的设计场景。 STM32微控制器家族是STMicroelectronics推出的一系列基于ARM Cortex-M架构的32位微控制器。它们广泛应用于嵌入式系统领域,并提供了丰富的外设接口以及高性能处理能力。在STM32F10x系列中,一些引脚默认配置为JTAG调试接口功能,在复位后即被设置为PA13、PA14、PA15及PB3和PB4等特定位置。这些JTAG引脚通常用于程序调试与边界扫描测试。 然而在某些应用场合下,我们可能需要将这些作为普通输入输出(IO)口使用,以便更充分地利用微控制器的所有资源。STM32的JTAG接口和GPIO可以通过软件配置进行切换:如果暂时不需要调试功能,则可以将其设置为普通的GPIO引脚以参与其他外设或功能实现。 为了改变JTAG端口的功能并使其作为普通IO口使用,首先需要了解的是高级外设复位(AFIO)机制。通过该机制可灵活地重新映射引脚配置,这正是我们能利用软件更改这些特定引脚用途的关键所在。具体步骤如下: 1. 开启AFIO时钟:在STM32中,APB2总线上的AFIO外设需要被启用才能进行引脚重映射操作。此过程可通过RCC_APB2PeriphClockCmd函数实现,并传入参数RCC_APB2Periph_AFIO以及设置为ENABLE。 2. 修改引脚的配置:可以通过GPIO_PinRemapConfig函数来更改这些特定引脚的功能,例如使用GPIO_Remap_SWJ_Disable关闭全部JTAG功能和SW-DP(串行线调试协议),或者利用GPIO_Remap_SWJ_JTAGDisable禁用仅限于JTAG而保持启用SWD接口。 3. 在系统初始化过程中开启AFIO时钟:在RCC_Configuration等函数中,务必记得启动AFIO的时钟支持。只有启用了此功能后,上述引脚映射更改才会生效。 4. 若需直接通过寄存器操作来配置JTAG模式,则可以通过设置或清除相关位来控制其启用/禁用状态。例如,在RCC->APB2ENR寄存器中第0位置1以开启辅助时钟,并利用AFIO->MAPR寄存器的[26:24]区间进行具体映射配置。 需要注意的是,将JTAG接口转换为普通GPIO可能会在调试过程中造成不便。一旦这些引脚被重新用作输入输出端口,在需要恢复调试功能时可能不得不重新设置它们或者选择其他方式进行连接和操作。 综上所述,通过上述方法可以灵活地调整STM32的特定引脚用途,并根据实际应用需求将其配置为普通GPIO或保留JTAG接口。这对于那些IO资源紧张的应用尤其重要,但同时也要求用户具备一定的系统时钟管理和外设配置知识以确保系统的稳定运行。
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    本研究基于ZYNQMP平台,探讨了其PS端PCIe 2.0 x4接口的功能特性,并进行了SSD速度测试,评估系统性能。 本段落介绍了基于ZynqMP的PS端PCIe 2.0 x4接口功能及SSD速度测试方法,其中连接到该接口上的SSD为采用NVMe接口的标准固态硬盘(SSD)。文章详细描述了使用Vivado进行PCIE配置、修改U-Boot设备树和内核源代码的过程,并通过dd命令对NVMe SSD的读写速度进行了测试。所有内容均经过实际验证,确保可行性和准确性,并在作者自行设计的板卡上得到了成功应用。本段落所使用的U-Boot和Linux内核源码均为基于Xilinx官方提供的版本进行移植与开发的结果。