Verilog编程测试反应时间
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简介：
本项目通过Verilog语言设计并实现一个用于测量用户对电子系统响应测试的时间程序，旨在评估和优化硬件系统的性能与速度。
本程序实现以下功能：
1. 基本部分：当控制开关开启后，在固定时间间隔（例如3秒）之后指示灯点亮。完成一次测试后，显示被测者的反应时间在数码管上。如果在指示灯点亮之前被测者按下按键，则视为违规，并给出警示。
2. 提高部分：
- 当控制开关开启时，在随机的时间间隔内（如不超过5秒）点亮指示灯。
- 在两人比赛中，通过比较谁先按下键来确定获胜者。
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