
基于五阶Sigma-Delta调制器的加速度计设计
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简介:
本研究提出了一种采用五阶Sigma-Delta调制技术的高性能加速度传感器设计方案,旨在提高测量精度和动态范围。
采用CHRT 0.35 μm CMOS工艺设计并实现了一种用于加速度计的单环五阶sigma-delta (ΣΔ) 调制器。在MATLAB/Simulink环境下对该调制器进行建模,并通过优化参数使系统稳定,利用根轨迹法分析了系统的稳定性。电路测试结果显示,在250 kHz采样频率和3.3 V电压条件下功耗为3.4 mW。后仿真结果表明,在1 kHz信号带宽下信噪比达到108.6 dB,有效位数约为18位,满足加速度计对高精度调制器的要求。
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