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NEU 东北大学计组课程设计完整代码5条指令cpu/20条指令cpu/多周期cpu

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简介：
1. 通过修复缺失代码，实现了具有5条指令的单周期CPU设计及验证工作； 2. 通过排查并纠正现有设计中的问题，实现了包含20条指令的单周期CPU设计及验证工作； 3. 基于现有实现了的单周期CPU平台，在其基础之上设计了一个无需考虑相关引发冲突的单发射型五级CPU结构，并完成了对其功能仿真及验证工作。

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  • 单周期CPU设计的18条指令
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    本文档详细介绍了基于Verilog语言实现的一个包含18条基本指令的单周期CPU的设计过程与架构分析。 ZJU计算机组成课程作业包含各部件代码，支持18条指令，包括slt、lui、slr、sll、jr、jal等指令。
  • 多周期CPU的54条MIPS指令
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    本文探讨了在多周期CPU架构中实现54条MIPS标准指令的方法，深入分析每条指令的执行流程和硬件设计需求。 本科生计算机组成原理课程的大作业使用了Xilinx N4开发板，在实验过程中实现了包含54条指令的多周期MIPS指令集CPU的设计。
  • 单周期CPU的31条指令
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    本文详细介绍了构建于单周期数据通路之上的经典计算机架构中的31条基本指令，包括每条指令的工作原理及应用场景。 采用单周期方式实现了MIPS的31条指令。提供了包含这31条指令仿真测试的coe文件以及每一条指令单独测试文件和测试结果，在Vivado2016和Modelsim上验证通过。
  • Logisim中MIPS多周期微指令CPU（含8条指令）的设计
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    本项目在Logisim环境中设计并实现了包含八条基本指令的MIPS多周期处理器。通过详细规划和构建数据通路及控制单元，确保了指令的有效执行与优化性能。 在华中科技大学的Logisim实验中，我们完成了计算机组成原理课程中的多周期微指令（8指令）CPU设计任务，并实现了电路的设计。该设计可以直接运行，也可以在网上进行闯关练习。
  • MIPS单周期CPU设计（含24条指令）(HUST)
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    本项目为华中科技大学课程作业，设计并实现了一个支持24条基本指令的MIPS单周期CPU，涵盖取指、译码、执行等核心过程。 让学生熟悉中断软硬协同的机制，并能够设计支持多级嵌套中断的单周期MIPS CPU。 为单周期MIPS增加单级中断机制，可以支持1、2、3共三个按键中断事件，其中断优先级依次是1 < 2 < 3。当CPU执行中断服务程序时不会被其他中断请求打断。
  • 基于ISE的12条MIPS指令多周期CPU设计
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    本项目基于Xilinx ISE开发环境，实现了一个能够执行12条基本MIPS指令的多周期CPU设计。通过Verilog硬件描述语言编写模块化代码，优化了处理器的数据通路和控制逻辑，实现了包括取指、译码、执行等核心功能。 12条MIPS指令多周期CPU设计【ISE实现】
  • 单周期CPU的31条MIPS指令
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    本项目详细介绍并实现了一个能够执行31条基本MIPS指令的单周期CPU设计。通过Verilog硬件描述语言编程，展示了数据路径、控制单元及寄存器组的具体构造方法。 本科生计算机组成原理课程大作业使用Xilinx N4开发板实验实现31条MIPS指令单周期CPU，该设计可以通过前仿真但不能下载到硬件板上运行，具体原因尚未查明。
  • 头歌-计组-MIPS单周期CPU设计（含24条指令）(HUST)
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    本项目是基于MIPS架构设计的单周期CPU课程作业，涵盖24条核心指令，适用于华中科技大学计算机组成原理教学。通过实践操作加深对计算机体系结构的理解与掌握。 头歌-计组-MIPS单周期CPU设计（24条指令），免费且无需积分。
  • MIPS单周期CPU组成原理实验——16位单周期CPU的28条指令原理图及24条指令的设计
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    本实验聚焦于构建一个基于MIPS架构的16位单周期CPU系统，涵盖其28种基本操作原理，并详细设计其中的24种核心指令，深入探讨硬件实现细节与优化策略。 使用Logisim布线完成的MIPS单周期CPU可以支持28条指令。跑马灯代码已装入寄存器，可以直接开启时钟运行。