
FPGA实现的DDS线性调频信号发生器(VHDL)
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简介:
本项目采用VHDL语言在FPGA平台上实现了直接数字合成(DDS)技术,设计并开发了一种高效的线性调频信号发生器,适用于雷达与通信系统。
使用VHDL编写的正弦波DDS线性调频信号发生器适用于FPGA开发环境。该设计中的ROM存储了1/4周期的波形数据,并且起始频率f1与终止频率f2在K_con.vhd模块中定义为常数。步进不仅通过频率控制字来实现,在检测到clk上升沿时,会增加相应的数值以完成线性调频功能。本程序已在QuartusII 9.0软件上调试成功。
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