
2-1MASH多路Sigma-Delta转换器设计
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简介:
本项目致力于研发一种创新性的2-1MASH结构多路Sigma-Delta调制器,旨在提高信号处理中的噪声抑制性能与动态范围,适用于高精度数据采集系统。
本段落介绍了一种采用全差分结构设计的量化器位数为3位级联结构调制器,并使用0.35 μm工艺实现。通过应用数据权重平均算法,有效降低了多位DAC对元件匹配性的要求。该系统在处理7.8125 kHz基带信号时,在500kHz的时钟速率下实现了高达87 dB的信噪比。结合抽取滤波器及校准算法的应用,输出结果无噪声分辨率达到了14.16位,并且模拟部分无需进行任何修调操作。
整体电路通过ADMS进行了混合仿真验证,并在3.3 V单电源供电条件下工作电流小于600 μA。
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