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采用Verilog-A行为描述模型的PLL系统设计 (2004年)

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简介：
本研究探讨了利用Verilog-A行为描述语言进行PLL（锁相环）系统的建模与仿真方法。通过该模型，实现了对PLL系统性能参数的有效分析和优化设计。 本段落分析了模拟硬件描述语言Verilog-A的特点，并介绍了一种基于Verilog-AHDL行为模型的自顶向下设计方法，这种方法适用于片上系统（SOC）中模拟部分的设计。根据压控振荡器（VCO）和二阶无源低通滤波器（LPF）的数学模型，建立了它们基于Verilog-A的行为模型，并用该方法实现了包含中心频率为120 MHz 的VCO 和截止频率为300.0 kHz 的LPF 在内的电荷泵锁相环系统设计。最后利用Cadence Spectre 仿真器对该模型进行了验证及PLL系统的级间仿真。

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  • 采用Verilog-A行为描述模型的PLL系统设计 (2004年)
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    本研究探讨了利用Verilog-A行为描述语言进行PLL（锁相环）系统的建模与仿真方法。通过该模型，实现了对PLL系统性能参数的有效分析和优化设计。 本段落分析了模拟硬件描述语言Verilog-A的特点，并介绍了一种基于Verilog-AHDL行为模型的自顶向下设计方法，这种方法适用于片上系统（SOC）中模拟部分的设计。根据压控振荡器（VCO）和二阶无源低通滤波器（LPF）的数学模型，建立了它们基于Verilog-A的行为模型，并用该方法实现了包含中心频率为120 MHz 的VCO 和截止频率为300.0 kHz 的LPF 在内的电荷泵锁相环系统设计。最后利用Cadence Spectre 仿真器对该模型进行了验证及PLL系统的级间仿真。
     
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