
基于FPGA的JPEG-LS图像压缩方案:支持可配置的无损和有损压缩,附带工程源码和仿真测试报告
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简介:
本项目提出了一种在FPGA上实现的JPEG-LS图像压缩算法,提供灵活的无损与有损压缩模式选择,并包含完整的硬件设计文件及验证文档。
本设计采用System Verilog语言开发了一种JPEG-LS图像压缩加速器,在FPGA系统下实现。输入数据为8位灰度图,输出为16位的JPEG-LS压缩后的图像数据。该方案集成了有损与无损两种压缩模式,并且在顶层参数配置中可以灵活选择这两种模式以及有损压缩时的不同等级(从1到7)。此外,还提供了加速器的仿真源文件,允许使用Vivado或其他软件进行详细测试和验证。
设计特点:
- 使用System Verilog语言编写
- 输入为8位灰度图像数据
- 输出为JPEG-LS格式的16位压缩数据
- 支持有损与无损两种压缩模式,并可通过参数配置选择具体模式及有损等级(从1到7)
- 提供完整的仿真文件,便于进一步开发和测试
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