
仿真实验中的阻塞与非阻塞现象
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简介:
本研究探讨了在仿真实验环境中常见的阻塞和非阻塞两种重要现象,分析其成因及影响,并提出相应的优化策略。
在 RTL 代码设计过程中,我们了解到使用“=”表示组合逻辑赋值,而使用“<=”表示时序逻辑赋值的重要性。如果违反这一规则,则可能会导致不可预期的结果。然而,在测试平台(Testbench)中,“=”与“<=”的使用似乎并不严格限制;两者都可以用来进行仿真,并且最终不会被综合为实际电路,因此不影响功能实现。尽管网络上的资料和教程对这两种赋值符号有不同的用法说明,但在 Testbench 中随意选择使用哪种赋值方式真的没有影响吗?通过一系列测试验证后发现结果出乎意料。
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