基于FPGA技术的打地鼠游戏实验
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简介：
本项目基于FPGA技术设计并实现了一款经典的打地鼠游戏。通过硬件描述语言编程，实现了游戏的基本功能和人机交互界面，为学习FPGA提供了生动的应用实例。
地鼠随机出现，通过按键打地鼠。当错误标志为高电平时，蜂鸣器发出滴滴声。
在Verilog Quartus II工程中的计数器部分，对50MHz的时钟信号进行计数，并且设定一个周期为0.5秒的计数值更新机制。具体实现如下：
```verilog
always @(posedge clk or negedge rst_n) begin
if (!rst_n)
alarm_cnt <= 25d0;
else if (alarm_cnt < 25d12500)
alarm_cnt <= alarm_cnt + 25d1;
else
alarm_cnt <= 25d0;
end
```
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