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CORDIC算法用Verilog语言进行了实现，并附带了测试环境。

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简介：
通过Verilog语言进行CORDIC算法的实现，其功能远比Xilinx平台所提供的版本更为全面和完善。该设计采用全并行结构，能够有效地计算正弦（sin）和余弦（cos）函数。

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  • 基于Verilog的CORDIC算法实现及测试基准
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    本文介绍了CORDIC算法在FPGA上的Verilog语言实现方法，并详细描述了该算法的测试基准设计和验证过程。 用Verilog实现CORDIC功能比Xilinx提供的更完善。采用全并行结构，可以计算正弦和余弦函数。
     
  • 基于Verilog的CORDIC算法实现及正余弦输出，附带测试程序与操作视频
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    本项目采用Verilog语言实现了高效的CORDIC算法，能够实时计算正弦和余弦值。提供详细的测试代码和演示操作视频，便于理解和应用。 领域：FPGA，Cordic算法 内容介绍：基于Verilog的Cordic算法实现，输出正弦和余弦，并包含testbench测试程序及代码操作视频。 使用目的：适用于学习Cordic算法编程的学生与研究人员（包括本科、硕士、博士等）进行教学研究之用。 运行提示： 1. 请确保使用vivado2019.2或者更高版本软件。 2. 打开FPGA工程后，请参考提供的操作录像视频，按照其中的步骤进行操作。 3. 工程路径必须为英文字符，不能包含中文。
     
  • LRU算法的C语言实现，使用了堆栈。
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    本段代码采用C语言实现了经典的LRU（最近最少使用）缓存置换算法，并巧妙地运用了数据结构中的堆栈来优化内存访问策略。 LRU算法的C语言实现使用了堆栈结构，代码简洁明了，思路清晰易懂。
     
  • 利用Verilog语言及LUT查找表技术实现CORDIC算法，生成正弦与余弦值，并附带testbench测试程序和代码操作教学视频
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    本项目采用Verilog语言结合LUT技术实现高效CORDIC算法，用于计算正弦和余弦值。包含详尽的testbench验证及教程视频，指导用户掌握代码调试与应用技巧。 领域：FPGA 内容：通过Verilog编程实现基于LUT查找表方法的Cordic算法，并输出正弦和余弦值，包含testbench测试程序以及代码操作视频。 用处：用于学习如何使用基于LUT查找表方法来编写Cordic算法。 指向人群：本科、硕士及博士等教研人员可以使用该资源进行研究或教学活动。 运行注意事项： 1. 使用Vivado 2019.2或者更高版本测试。 2. 打开FPGA工程后，请参考提供的操作录像视频逐步完成相关操作。 3. 确保工程路径为英文，不能包含中文字符。
     
  • 基于FPGA的CORDIC算法正弦余弦输出，Verilog语言实现，使用Vivado 2019.2平台及测试基准-附源码
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    本项目采用Verilog语言在FPGA平台上实现了CORDIC算法以计算正弦和余弦值，并通过Vivado 2019.2进行设计验证，提供完整的源代码。 基于FPGA的CORDIC算法输出正弦余弦，在Vivado 2019.2平台上使用Verilog编程实现，并包含测试平台（testbench）源码。
     
  • CORDIC算法在Verilog中的实现
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    本文探讨了CORDIC算法在Verilog硬件描述语言中的实现方法，详细介绍了CORDIC算法的基本原理及其在FPGA设计中的应用，并提供了具体的Verilog代码示例。 基于FPGA的CORDIC算法程序可以输出IQ信号的幅度及相位。该系统的精度较高，相位精度为2/9000，幅度精度为1/1000。其中伴随项扩大了100倍，而幅度则放大了1.6倍。
     
  • 基于Verilog的Pipelined Cordic算法实现
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    本项目采用Verilog语言实现了流水线CORDIC算法，优化了计算过程中的硬件资源利用率和运算速度，适用于高性能信号处理系统。 该设计包含两种模式：1) 旋转模式，能够根据输入的角度对向量进行旋转；2) 向量模式，用于计算输入向量的相位。 采用了pile-line结构来降低FPGA在时间上的要求，并且pipeline的数量以及每级pipe的stage数量均可通过参数配置调整。此设计已经在芯片中实现并投入量产，特别适用于通信领域的信号处理。
     
  • C语言中CORDIC计算sinx的算法实现
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    本篇文章详细介绍了在C语言环境中利用CORDIC算法高效计算正弦值的方法，并探讨了其实现细节和优化策略。 用C语言实现CORDIC算法计算sinx，在理论上比使用math.h中的sin函数要快得多。这段代码在VC6编译环境下是完全正确的。
     
  • 用Verilog语言进行CRC校验的实现
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    本文章详细介绍了如何使用Verilog硬件描述语言来设计并实现CRC（循环冗余校验）算法，以确保数据传输过程中的完整性。通过具体的实例分析和代码展示，帮助读者掌握在FPGA或ASIC设计中应用CRC校验的方法和技术细节。适合电子工程、计算机科学等相关专业的学生及工程师阅读学习。 功能：输入多个8位数据，输出16位CRC值，使用的多项式为CRC8005。通过修改例程中的某字节（程序中有注明），可以实现CRC1021的计算。