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Verilog 语言教程

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《Verilog语言教程》是一本全面介绍硬件描述语言Verilog的基础与高级特性的指南书籍，适合电子工程和计算机专业的学生及从业人员阅读。 Verilog 教程 Verilog 教程 Verilog 教程 Verilog 教程 Verilog 教程

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  • Verilog 语言教程
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    《Verilog语言教程》是一本全面介绍硬件描述语言Verilog的基础与高级特性的指南书籍，适合电子工程和计算机专业的学生及从业人员阅读。 Verilog 教程 Verilog 教程 Verilog 教程 Verilog 教程 Verilog 教程
  • Verilog语言的PDF教程
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    本PDF教程全面介绍了Verilog硬件描述语言的基础知识和高级特性，适合电子工程及相关领域的学习者与工程师参考使用。 目录 译者序 前言 第1章 简介 1.1 什么是Verilog HDL？ 1.2 历史 1.3 主要能力 第2章 HDL指南 2.1 模块 2.2 时延 2.3 数据流描述方式 2.4 行为描述方式 2.5 结构化描述形式 2.6 混合设计描述方式 2.7 设计模拟 第3章 Verilog语言要素 3.1 标识符 3.2 注释 3.3 格式 3.4 系统任务和函数 3.4.1 `define 和 `undef 3.4.2 `ifdef、`else 和 `endif 3.4.3 `default_nettype 3.4.4 `include 3.4.5 `resetall 3.4.6 `timescale 3.4.7 `unconnected_drive和`nounconnected_drive 3.4.8 `celldefine 和`endcelldefine 3.5 值集合 3.5.1 整型数 3.5.2 实数 3.5.3 字符串 3.6 数据类型 3.6.1 线网类型 3.6.2 未说明的线网 3.6.3 向量和标量线网 3.6.4 寄存器类型 3.7 参数 第4章 表达式 4.1 操作数 4.1.1 常数 4.1.2 参数 4.1.3 线网 4.1.4 寄存器 4.1.5 位选择 4.1.6 部分选择 4.1.7 存储器单元 4.1.8 函数调用 4.2 操作符 4.2.1 算术操作符 4.2.2 关系操作符 4.2.3 相等关系操作符 4.2.4 逻辑操作符 4.2.5 按位操作符 4.2.6 归约操作符 4.2.7 移位操作符 4.2.8 条件操作符 4.2.9 连接和复制操作 4.3 表达式种类 第5章 门电平模型化 5.1 内置基本门 5.2 多输入门 5.3 多输出门 5.4 三态门 5.5 上拉、下拉电阻 5.6 MOS开关 5.7 双向开关 5.8 门时延 5.9 实例数组 5.10 隐式线网 5.11 简单示例 5.12 2-4解码器举例 5.13 主从触发器举例 5.14 奇偶电路 第6章 用户定义的原语 6.1 UDP的定义 6.2 组合电路UDP 6.3 时序电路UDP 6.3.1 初始化状态寄存器 6.3.2 电平触发的时序电路UDP 6.3.3 边沿触发的时序电路UDP 6.3.4 边缘和电平混合行为 6.4 另一实例 6.5 表项汇总 第7章 数据流模型化 7.1 连续赋值语句 7.2 示例 7.3 线网说明赋值 7.4 时延 7.5 线网时延 7.6 示例 7.6.1 主从触发器 7.6.2 数值比较器 第8章 行为建模 8.1 过程结构 8.1.1 initial语句 8.1.2 always语句 8.1.3两类语句在模块中的使用 8.2 时序控制 8.2.1 延迟控制 8.2.2事件控制 8.3
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